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資料中心級驗證平台現身 應用處理器開發有福了
 

【CTIMES 姚嘉洋 報導】   2015年12月08日 星期二

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近年來,EDA(電子設計自動化)市場的主要議題,大多都圍繞在驗證模擬領域,理由在於晶片開發需要更多的第三方供應商提供矽智財,以快速完成晶片設計,所以在尚未進入測試晶片階段前,其模擬驗證的流程就扮演了最後一道檢核的關卡。

Cadence主管群
Cadence主管群

Cadence(益華電腦)先前在驗證領域就推出了Palladium XP Ⅱ平台,其目標客群就鎖定了諸多需要先進製程的處理器業者,據了解,Cadence在這段期間也奪得不少客戶的青睞。但在今年十一月,Cadence趁勝追擊推出全新一代的Palladium Z1,這也是業界首款以資料中心等級打造而成的硬體驗證模擬(emulation)平台。據Cadence透露,其硬體平台所需要的處理器,是由Cadence自行設計開發,再委由台積電以28奈米製程量產而成。

Cadence驗證產品管理部門協理Michael Young表示,Cadence在模擬驗證領域投入了28年的時間,從一開始的1987年到2009年的期間,在硬體平台的開發上,採用了以FPGA(可編程邏輯閘陣列)為基礎的晶片架構,到了1995年至2009年,則改採以處理器架構來設計,不同的硬體晶片架構,各有其優缺點,像是FPGA雖然處理性能較佳,但是在除錯能力上,無法看出諸多問題的細節,工程師就無法判斷問題從何而來,而隨著經驗的累積,在2010年,Cadence集處理器與FPGA的優點,大幅提升運算效能,在最短時間內找出實際的設計問題。先前推出的Palladium XP 與Palladium XP Ⅱ便是最好的例子。

當然,以一家具有規模的處理器業者而言,設計團隊不太可能僅有一個設計專案在進行,同時有好幾個專案進行是相當常見的,Z1除了能因應智慧型手機市場所需要的應用處理器設計外,Michael Young不諱言,Z1也能應付基地台專用的處理器設計,Z1可以平行處理多達2,304個執行工作。他也指出,一顆應用處理器的工作負載因應不同需求,要求也會不同,Z1可以直接對應該處理器設計的多種工作負載模式來進行模擬驗證。

Palladium Z1相較於前一代產品,在各方面的規格上,都有一定程度的提升, 其鎖定的目標客戶,自然也是前面所提到的應用處理器業者。Cadence亞太區系統解決方案暨驗證平台協理張永專進一步指出,以智慧型手機市場來說,的確出現了成長動能趨緩的狀況,但是應用處理器還是有一定的開發難度在,未來進入5G時代,設計難度並不會有所降低。所以即便客戶擁有前一代的硬體平台,但若有了Z1,在這類處理器的開發上便能省下更多的時間與成本,嚴格來說是投資效益極高的硬體平台。張永專也強調,舊有平台的維護與升級,Cadence仍會持續進行,他也不諱言,現有的客戶群中,同時擁有新舊平台的,亦不在少數。

關鍵字: 應用處理器  資料中心  EDA  模擬  驗證  FPGA  除錯  益華電腦(Cadence
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