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清晰通話輕而易舉 以SigmaDSP實現AEC聲學迴聲消除
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【課程簡介】:
聲學迴聲消除(AEC)目的是用來消除信號中的迴聲、混響和雜訊等干擾。當聲音從遠端輸入,將被同步發送到DSP路徑和聲學路徑上。聲學路徑包括一個揚聲器、一個聲學環境和一個將信號收回DSP的麥克風。AEC上則具備一個自適應FIR濾波器。這種迴聲消除的架構會不斷調整濾波器來對聲波路徑進行建模。然後,從聲波路徑的信號中減去濾波器的輸出,藉此來產生乾淨的信號輸出,並且很大程度地消除了聲音的線性回波。 當遠端信號透過本地端揚聲器播放並由麥克風收音時,就會需要AEC來進行迴聲消除。如果少了AEC,則聲音的延遲以及混響的迴聲都將一併被近端收音並放至遠端

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如何設計/優化/測試多通道高速介面接收端與發射端訊號品質

隨著5G通訊技術的普及,電子裝置與系統的複雜性和資料速率不斷升高,工程師在測試這些裝置時面臨著更多 的挑戰。當資料速率較低時,單通道測試即可滿足要求。但如果資料速率較高,工程師可能會遇到各式各樣的 串擾,抖動等問題。因此,在處理不同干擾源和干擾信號應用時,多通道測試就變得十分重要。本次線上研討 會您將學習到從如何優化&測試高速通訊數位鏈路的接收機,發射機的訊號品質並達成Error-Free 的目標

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千兆位元鏈路的自動化驗證方案!  

對千兆(Gigabit)SerDes的信道進行佈線後驗證,是一項具有挑戰性但也是必要的任務,因為即使是最詳細的預先佈局模擬研究和佈線指南也不能預測一切。滿足詳細佈線要求的設計,仍然可能會由於不連續和不可預期的諧振而導致失敗。 在現代設計中,大量的信道使得佈線後驗證變得更困難,每個信道都必須單獨建模和分析,這需要一個自動化、高效率的過程才能成功

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ModelSim Essential ++ ModelSim 應用進階  

掌握ModelSim 高效率完成FPGA整體設計驗證隨著今日FPGA的應用日漸廣泛,FPGA的容量和功能持續增加,FPGA驗證方法和工具已經變得越來越重要了,而FPGA驗證的複雜性,使得工程師必須有專業的驗證團隊,並使用專業的驗證工具。本次的線上研討會將從驗證工具ModelSim的基本功能介紹出發,透過對ModelSim的安裝、進階技巧介紹,讓工程人員能夠掌握ModelSim的使用技巧,更高效率地完成FPGA項目的整體設計和驗證

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電源設計關鍵環節 深度聚焦電路佈線細節

在前面幾場的活動中,已經將電源設計從基本概念到設計佈線都完整的一一解說。那麼,如何依據這些設計原則,真正的著手設計出一個符合使用需要的電源電路設計,就非常重要了。實際設計通常與理想狀況會有一段的差距,經常在設計電源電路時,會有看不見的魔鬼藏在細節裡面,一旦在設計的初期忽略了這些細節,問題往往就在後期慢慢浮現

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智慧製造及智慧物流應用技術論壇 ( 04/21 )
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