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CTIMES / 台積電
科技
典故
Internet的起源

組成Internet的兩大元件,一是作為傳達內容的本體—超文本,另一個是傳輸的骨幹—網路,網際骨幹可追溯到1968年的美俄冷戰時期,當時美國國防部的DARPA計畫發展出ARPANET,網頁結構則是由超文件(Hypertext)演變而來。
Cadence GDDR6 IP產品獲台積電N6製程認證 (2020.10.12)
電子設計大廠益華電腦(Cadence Design Systems, Inc.)宣佈,其GDDR6 IP獲得台積電6奈米製程(N6)矽認證,可立即用於N6、N7與還有即將到來的N5製程技術。GDDR6 IP由Cadence PHY和控制器設計IP與驗證IP(VIP)所組成,目標針對超高頻寬的記憶體應用,包括超大型運算、汽車、5G通訊及消費性電子,特別有關於人工智慧/機器學習(AI/ML)晶片中的記憶體介面
Cadence IC封裝參考流程 獲得台積電最新先進封裝技術認證 (2020.09.16)
益華電腦(Cadence Design Systems)宣佈,Cadence工具取得台積電最新 InFO 與CoWoS先進封裝解決方案認證,即以RDL為基礎的整合扇出型封裝InFO-R,與採用矽晶中介層(Silicon Interposer)封裝技術的CoWoS-S
Mentor通過台積電最新3奈米製程技術認證 (2020.09.11)
Mentor,a Siemens business近期宣佈旗下多項產品線和工具已獲得台積電(TSMC)最新的3奈米(N3)製程技術認證。 台積電設計建構管理處資深處長Suk Lee表示:「此次認證進一步突顯了Mentor為雙方共同客戶以及台積電生態系統所創造的價值
【影片】新聞十日談#3|台積電的4奈米和3D IC (2020.09.10)
作為全球半導體製造技術先鋒,台積電積極部署先進製程的發展藍圖,先前更於其法說會宣布4nm製程N4與3D IC堆疊技術3D Fabric的資訊,大大彰顯其欲進一步推進市場主導地位的決心與行動力
Ansys多物理場解決方案 通過台積電3D IC封裝技術認證 (2020.08.31)
Ansys先進半導體設計解決方案通過台積電(TSMC)高速CoWoS-S (CoWoS with silicon interposer)和InFO-R(InFO with RDL interconnect)先進封裝技術認證。這讓客戶針對整套整合2.5D和3D晶片系統,簽核耗電、訊號完整性和分析熱效應衝擊,確認其可靠度
為什麼台積的4奈米和3D IC整合服務是亮點? (2020.08.30)
受到新冠肺炎(COVID-19)疫情的影響,台積(TSMC)技術論壇和開放創新平台(Open Innovation Platform)生態系統論壇,今年也首次轉為線上的形式。雖說是開放創新,其實台積的論壇都是屬於半封閉式,是必須要有邀情函才能夠註冊參加
Ansys多物理場解決方案 通過台積電3奈米製程技術認證 (2020.08.26)
Ansys宣布,其先進多物理場簽核(signoff)工具通過台積電(TSMC)最先進3奈米(nm) 製程技術認證。此舉將滿足雙方共同客戶對人工智慧/機器學習 (AI/ML)、5G、高效能運算 (HPC)、網路和自駕車晶片的重要耗電、熱和可靠度需求
台積線上技術論壇亮點:4奈米與3D IC系統整合服務 (2020.08.25)
因應新冠肺炎(COVID-19)影響,台積公司(TSMC)今年首度舉辦線上的技術論壇和開放創新平台(Open Innovation Platform, OIP)生態系統論壇。會中除了提及5奈米與3奈米的技術時程外,也披露了最新的4奈米技術,預計在2022年量產;此外,台積也首度發表3DFabric系統整合服務,為整合SoIC、CoWoS和InFO技術的完整3D IC代工服務
M31完成開發台積電22nm的完整實體IP方案 (2020.07.24)
矽智財供應商?星科技(M31 Technology)宣布,已在台積電22奈米製程平台開發完整的實體IP,此技術平台包括超低功耗Ultra-Low Power(22ULP)及超低漏電Ultra-Low Leakage(22ULL)方案,提供客戶SoC設計所需的各式基礎元件、記憶體、高速介面和類比電路等IP
EDA雲端化一舉解決IC設計痛點 (2020.07.03)
今年六月,EDA龍頭廠商Cadence和Synopsys更同時宣布與台積電、微軟策略合作,採用微軟Azure雲端平台以加速IC設計流程的合作計畫,顯見EDA已正式進入雲端化時代。
Cadence與台積電、微軟合作 以雲端運算縮減IC設計簽核時程 (2020.06.17)
益華電腦(Cadence Design Systems, Inc.)宣佈與台積電及微軟三方合作之成果。該合作的重點是利用雲端基礎架構來縮短半導體設計簽核時程。透過此合作,客戶將可藉由微軟 Azure上的Cadence CloudBurst平台,採用台積電技術的Cadence Tempus時序簽核解決方案及Quantus提取解決方案,獲得加速完成時序簽核的途徑
三大規範指標 讓節能省電變成企業競爭力 (2020.06.15)
對於商業公司來說,節能減碳已經不能再是一個口號,更不是一個主觀的目標,它已經是客觀的指標,並且有明確的實施規範。
恩智浦新一代高效能汽車平台 採用台積電5奈米製程 (2020.06.12)
恩智浦半導體(NXP Semiconductors N.V.)和台灣積體電路製造股份有限公司(TSMC)今(12)日宣布合作協議,恩智浦新一代高效能汽車平台將採用台積公司5奈米製程。此項合作結合恩智浦的汽車設計專業與台積公司領先業界的5奈米製程,進一步驅動汽車轉化為道路上的強大運算系統
產業鏈梅花座 (2020.06.05)
過去很長一段時間,在全球化趨勢下,使得產業在世界各地布局分工相當明顯,設計行銷等高利潤的行業多集中在歐美等已開發國家,而製造、組裝等多集中在低成本、人力充沛的開發中國家
Mentor Calibre和Analog FastSPICE平台 通過台積電最新製程認證 (2020.05.26)
Mentor(西門子旗下子公司)近期宣佈,該公司的多項IC設計工具已獲得台積電領先業界的N5和N6製程技術認證。此外,Mentor與台積電的合作關係已擴展到先進封裝技術,可進一步利用Mentor Calibre平台的3DSTACK封裝技術來支援台積電的先進封裝平台
新冠疫情+美中衝突 台灣供應鏈布局要有新思維 (2020.05.25)
新冠肺炎(COVID-19)幾乎讓世界各國的經濟陷入停滯,僅有少數的國家(台灣是其中一個)可以正常的運作。然而眼前急速升溫的美中對抗,則是讓脆弱的產業營運雪上加霜
台積電宣布赴美設廠12吋半導體供應鏈不排除一併前往 (2020.05.15)
台積電(TSMC)於5月15日宣布將於美國亞利桑那州新建一座12吋先進晶圓廠,預計2021年動工,2024年開始量產,規劃以5奈米製程生產半導體晶片,月產能為20K;此專案投資金額約為120億美元
台積電與交大聯手突破大面積單晶技術 成果首登《自然》期刊 (2020.03.17)
在科技部「尖端晶體材料開發及製作計畫」支持下,交通大學(交大)的研究團隊與台積電合作組成的聯合研究團隊,在共同進行單原子層氮化硼的合成技術上有重大突破,成功開發出大面積晶圓尺寸的單晶氮化硼之成長技術,未來將有機會應用在先進邏輯製程技術,研究成果於今年(2020) 3月榮登於全球頂尖學術期刊《自然》(Nature)
5G帶來半導體大反彈 台積電今年成長有望超過17% (2020.01.16)
台積電(TSMC)於今日(16日)舉行了2019年第四季的法人說明會。而此場法說會,也是台積電新陣容的首次登台,包含新任的企業訊息處處長蘇志凱,以及第二次登台的財務長暨發言人黃仁昭
M31獲頒台積電OIP生態系統論壇汽車IP論文客戶首選獎 (2020.01.14)
全球矽智財開發商 M31科技宣布,2019年於台積電開放創新平台生態系統論壇(TSMC 2019 Open Innovation Platform Ecosystem Forum)活動,針對汽車IP所發表的一篇技術論文榮獲首選獎項(Customers’ Choice Award)

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10 西門子與台積電合作 助客戶實現IC最佳化設計

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