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應用自動化驗證工具消除線路圖設計的錯誤
 


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開始時間﹕ 三月三日(四) 10:30 結束時間﹕
主辦單位﹕ SIEMENS EDA,CTIMES
活動地點﹕
聯 絡 人 ﹕ 聯絡電話﹕
報名網頁﹕ https://register.gotowebinar.com/register/5183712860881738253
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在這設計日益複雜的PCB板設計中,仰賴人工檢查線路圖設計已不再可行,如何應用工具進行自動化消除線路圖設計的錯誤,是每個追求低成本及及時上市公司所面臨的挑戰。在本次線上研討會中,將探討線路圖設計中常犯的錯誤及不容易使用人工的方式被檢查出來的錯誤及其可行的解決方案,以確保線路圖設計的正確性、減少因PCB返工造成的成本和人力的浪費,達到即時上市並最大化公司利潤的目標。

研討會亮點 :

1. PCB設計驗證的左移策略

2. 線路圖設計驗證的執行效率

3. 線路圖設計驗證更好的解決方案

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