PCIe 8.0草案正式发布 加速AI与光学互连布局

PCI-SIG主席Al Yanes在日前的开发者大会上正式宣布，PCIe 8.0规格的Draft 0.5版本已经释出，象徵传输速率将要迈向256GT/s的新高度。此外大会也更新了PCIe 7.0标准、CopprLink电缆规范及光学感知架构(Optical Aware Retimer)的落地资讯，进一步将PCIe技术从传统的板载汇流排，转型为支撑大型AI集群的高性能互连生态系。

PCI-SIG组织成立於1992年，目前持续着每三年频宽翻倍的技术路线图。自2003年发布首代PCIe规格以来，该组织成员已於2024年突破1,000家企业。PCIe技术也广泛应用於汽车电子、储存系统、IoT设备及军事航太等垂直领域。

图一 : PCI-SIG每三年频宽翻倍的技术路线图。

根据最新发布的技术指标，PCIe 8.0规格预计在x16组态下提供高达1.0TB/s的双向传输频宽。该规格将原始位元速率提升至256.0GT/s，并延用PCIe 6.0以来的PAM4信号技术与Flit模式编码。目前研发重点在於评估新型连接器技术，并在维持向下相容性的前提下，确保达成低延迟与高可靠性的目标。
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