虹晶提供特许65奈米低功率制程的测试晶片

虹晶科技，ㄧ家台湾在SoC设计服务公司，於2007年底宣布完成基於特许半导体65奈米低功率制程的发展套件後，再度宣布推出基於此制程的测试晶片，来提供给使用ARM926EJ-S的系统设计。此设计晶片，发展於特许半导体65奈米低功率制程，速度可高达500MHz，属於虹晶科技所推出针对基於安谋(ARM)SoC系统雏型设计，预先整合以及预先验证过的IP及软体平台的一部分。

於虹晶科技代号为CMPU491A的这颗测试晶片，完成於特许半导体的完整设计解决方案，包含来自於安谋的65低功率Advantage Library、SP SRAM compiler, 来自於Aragio的low profile一般用途I/O，还有来自True Circuit 的PLL，共同组成此测试晶片。包含於此晶片中的硬核ARM926EJ亦经过了特许半导体的生产设计(DFM)审核，可随时整合至客户的产品设计。

CMPU491A包含一个AHB介面，采用QFP256的包装，内含16KByte/16kByte的指令与资料快取记忆体，16KByte/16Byte的TCM，高达500MHz的性能。使用特许65奈米低功率的制程，CMPU491A的功能在虹晶科技的发展工具平台CDK上获得完整验证(CDK:虹晶科技所发展出来的验证平台，专为验证专属於AMBA的IP跟SoC)。
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