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同步资料转换器阵列的取样时脉
建立灵活、可再程式设计的时脉扩展网路

【作者: Kazim Peker/ Altug Oz】2016年11月28日 星期一

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包括从通信基础设施到量测仪器等各种应用对更高系统频宽和解析度的要求,带动了采阵列形式连接多个资料转换器的需求。设计工程师必须找到低杂讯、高精度的解决方案,以便对使用常见JESD204B串列资料转换器介面的大型阵列资料转换器进行时脉(clock)和同步。


为解决这样的系统问题,含有抖动衰减函数、内部VCO,和大量输出与许多同步管理功能的时脉产生设备,正纷纷推出市场。然而,在许多实际的应用中,资料转换器阵列中所需的时脉数量之多,超过了从单一IC元件可获得的数量。设计工程师经常只能求助于将多个时脉产生器和时脉分配元件连接在一起,因此,创造出了广泛的时脉树 (clock tree)。
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