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三方合作 MIPS研發出新高效ASIC處理器設計
 

【CTIMES/SmartAuto 陳盈佑 報導】   2009年10月30日 星期五

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Open-Silicon、MIPS、以及Virage Logic共同宣佈,成功開發一款測試晶片,展現建置高效能處理器系統的能力。此處理器測試晶片在1.1GHz的時脈速度,成功通過65奈米矽晶測試。同時,後續40奈米元件的開發也已開始進行,目標是要超過2.5GHz,並提供5000 DMIPS的效能。這項開發計畫採用了Open-Silicon的CoreMAX技術以及超純量MIPS32 74K處理器核心。

74K處理器核心具備32KB L1指令和數據快取、512KB L2快取、以及系統和記憶體控制器模塊,並採用台積電的65奈米GP製程、搭配標準10軌單元庫、以及Virage Logic的SiWare Memory編譯器。此晶片已可成功在1.1GHz速度執行。Open-Silicon應用其專利的CoreMAX效能增強技術於此設計中,可允許設計人員建置數百萬個新的標準單元,尤其是用來加速此設計的關鍵路徑。再加上SiWare Memory編譯器和三重Vt製程選項,使得最終設計的各種最差時脈收斂達到1.1GHz,並仍保有標準ASIC的餘量。

40奈米測試晶片目前正開發中,計畫於2010年第一季完成。它的效能目標希望頻率能超過2.5GHz,同時最高可提供超過5000 DMIPS的速度。此測試晶片將包含74K處理器核心的浮點運算版本,以及L2快取、系統和記憶體控制器模塊。

關鍵字: ASIC  Open-Silicon  MIPS  Virage Logic  可編程處理器 
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