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Cadence與聯電合作開發22ULP/ULL製程認證 加速5G與車用設計 (2021.07.13)
聯華電子今日宣布，Cadence優化的數位全流程，已獲得聯華電子22 奈米超低功耗 (ULP) 與 22 奈米超低漏電 (ULL) 製程技術認證，以加速消費、5G 和汽車應用設計。該流程結合了用於超低功耗設計的領先設計實現和簽核技術，協助共同客戶完成高品質的設計並實現更快的晶片設計定案 (tapeout) 流程
捷碼Talus及Quartz軟體通過台積電40奈米驗證 (2008.06.25)
晶片設計解決方案供應商Magma捷碼科技發表了Talus IC應用程式、Quartz SSTA統計分析、Quartz DFM、Quartz LVS及SiliconSmart DFM等產品，都能經由台積電（TSMC）的Reference Flow 9.0存取。這些工具軟體完全支援台積電的「主動精準保證機制」（Active Accuracy Assurance Initiative），這項機制定訂了台積電旗下所有設計生態夥伴在精準方面的共同標準
捷碼、明導與新思共同推出統一功率格式產品 (2008.02.01)
捷碼科技有限公司(Magma Design Automation Inc.)、明導國際(Mentor Graphics Corporation)和新思科技(Synopsys, Inc.)，宣布三家公司將共同推出符合Accellera發展的統一功率格式標準UPF 1.0的低功率EDA(電子設計自動化)工具組，包括這三家公司製造的各種實作與驗證工具


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