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西門子與台積電合作 助客戶實現IC最佳化設計 (2023.10.12)
西門子數位化工業軟體宣佈與台積電深化合作,展開一系列新技術認證與協作,多項西門子 EDA 產品成功獲得台積電的最新製程技術認證。 台積電設計基礎架構管理部門負責人 Dan Kochpatcharin 表示:「台積電與包括西門子在地的設計生態系統夥伴攜手合作
西門子提供EDA多項解決方案 通過台積電最新製程認證 (2023.05.10)
身為台積電的長期合作夥伴,西門子數位化工業軟體日前在台積電2023 年北美技術研討會上公布一系列最新認證,展現雙方協力合作的關鍵成果,將進一步實現西門子EDA技術針對台積電最新製程的全面支援
2奈米即將來臨 Ansys多物理解決方案取得台積電N2製程認證 (2023.05.08)
Ansys 宣布,Ansys電源完整軟體通過台積電N2製程技術認證。台積電N2製程採用奈米電晶體結構,對高效能運算(HPC)、手機晶片和 3D-IC晶片的速度與功率具有優勢。Ansys RedHawk-SC和Ansys Totem皆通過 N2 的電源完整性簽核認證,包括元件和導線的自發熱運算,以及考量散熱的電遷移流程
Cadence數位與客製/類比流程 獲台積電N4P和N3E製程技術認證 (2022.11.03)
益華電腦(Cadence Design Systems, Inc.)宣布,Cadence數位與客製/類比設計流程,通過台積電N4P與N3E製程認證,支持最新的設計規則手冊(DRM)與FINFLEX技術。Cadenc為台積電N4P和 N3E 製程提供了相應的製程設計套件 (PDK),以加速先進製程行動、人工智慧和超大規模運算的設計創新
西門子多款IC設計解決方案獲台積電最新技術認證 (2022.06.28)
西門子數位化工業軟體近期在台積電2022技術論壇上宣佈,旗下多款先進工具已獲得台積電最新技術認證。 其中,西門子Aprisa數位實作解決方案獲得台積電業界領先的N5與N4製程認證
新思SiliconSmart元件庫獲台積電先進製程認證 (2022.01.17)
新思科技SiliconSmart元件庫特性(library characterization)解決方案已獲得台積公司N5、N4和N3製程技術的認證。作為新思科技融合設計平台一環,該解決方案具備了支援先進節點的單位元件庫特性所需的強化功能,能加速行動/5G、高效能運算、人工智慧 (AI)、汽車、互聯網(IoT)網路以及航太和國防應用的數位實作
Ansys獲台積電2021年度開放創新平台(OIP)合作夥伴獎 (2021.11.28)
Ansys宣布,獲兩項台積電(TSMC)2021年度開放創新平台(Open Integration Platform;OIP)合作夥伴獎,包括共同開發4奈米(nm)設計基礎架構和共同開發3DFabric設計解決方案。 年度共同夥伴獎肯定台積電開放創新平台 (OIP) 生態系統合作夥伴在過去一年對支援新世代設計的卓越貢獻
Cadence數位、客製與類比流程 獲台積電3奈米和4奈米製程認證 (2021.11.11)
Cadence Design Systems, Inc.宣布,其數位和客製/類比流程已獲得台積電 N3 和 N4 製程技術的認證,以支持最新的設計規則手冊 (DRM)。Cadence 和台積電雙方持續的合作,為台積電 N3 和 N4 製程提供了相應的製程設計套件 (PDK),以加速行動、人工智慧和超大規模運算的創新
西門子與台積電深化合作 3D IC認證設計達成關鍵里程 (2021.11.04)
西門子數位化工業軟體,日前在台積電 2021開放創新平台 (OIP) 生態系統論壇中宣布,與台積電合作帶來一系列的新產品認證,雙方在雲端支援 IC 設計,以及台積電的全系列 3D 矽晶堆疊與先進封裝技術(3Dfabric)方面,已經達成關鍵的里程碑
Cadence與聯電合作開發22ULP/ULL製程認證 加速5G與車用設計 (2021.07.13)
聯華電子今日宣布,Cadence優化的數位全流程,已獲得聯華電子22 奈米超低功耗 (ULP) 與 22 奈米超低漏電 (ULL) 製程技術認證,以加速消費、5G 和汽車應用設計。該流程結合了用於超低功耗設計的領先設計實現和簽核技術,協助共同客戶完成高品質的設計並實現更快的晶片設計定案 (tapeout) 流程
Mentor高密度先進封裝方案 通過三星Foundry封裝製程認證 (2020.12.01)
Mentor, a Siemens business宣佈其高密度先進封裝(HDAP)流程已獲得三星Foundry的MDI(多晶粒整合)封裝製程認證。Mentor和西門子Simcenter軟體團隊與三星Foundry密切合作,開發了原型製作、建置、驗證和分析的參考流程,提供先進多晶粒封裝的完備解決方案
Mentor獲兩項台積電OIP年度合作夥伴獎 (2020.11.04)
Mentor, a Siemens Business近日憑藉其EDA解決方案,獲得由台積電(TSMC)頒發的兩項2020年度OIP合作夥伴獎。該獎項旨在表彰Mentor等台積電開放創新平台(OIP)生態系統的合作夥伴,在過去一年為實現下一世代晶片級系統(SoC)及三維積體電路(3DIC)設計所做的傑出貢獻
Cadence GDDR6 IP產品獲台積電N6製程認證 (2020.10.12)
電子設計大廠益華電腦(Cadence Design Systems, Inc.)宣佈,其GDDR6 IP獲得台積電6奈米製程(N6)矽認證,可立即用於N6、N7與還有即將到來的N5製程技術。GDDR6 IP由Cadence PHY和控制器設計IP與驗證IP(VIP)所組成,目標針對超高頻寬的記憶體應用,包括超大型運算、汽車、5G通訊及消費性電子,特別有關於人工智慧/機器學習(AI/ML)晶片中的記憶體介面
Mentor通過台積電最新3奈米製程技術認證 (2020.09.11)
Mentor,a Siemens business近期宣佈旗下多項產品線和工具已獲得台積電(TSMC)最新的3奈米(N3)製程技術認證。 台積電設計建構管理處資深處長Suk Lee表示:「此次認證進一步突顯了Mentor為雙方共同客戶以及台積電生態系統所創造的價值
Ansys多物理場解決方案 通過台積電3奈米製程技術認證 (2020.08.26)
Ansys宣布,其先進多物理場簽核(signoff)工具通過台積電(TSMC)最先進3奈米(nm) 製程技術認證。此舉將滿足雙方共同客戶對人工智慧/機器學習 (AI/ML)、5G、高效能運算 (HPC)、網路和自駕車晶片的重要耗電、熱和可靠度需求
Mentor EDA進一步支援三星Foundry 5/4奈米製程技術 (2020.08.22)
Mentor, a Siemens business旗下的Calibre nmPlatform和Analog FastSPICE(AFS)自訂和類比/混合訊號(AMS)電路驗證平台已通過三星Foundry的最新製程技術認證。客戶現在可以在三星的5/4奈米FinFET製程上使用這些產品,為其先進的IC設計tapeouts進行驗證和sign-off
Mentor全新Analog FastSPICE eXTreme技術 提升10倍驗證效能 (2020.08.05)
Mentor, a Siemens business近期推出支援大型、佈局後(post-layout)類比設計的奈米級驗證Analog FastSPICE eXTreme技術,可大幅提高模擬效能,並確保奈米級類比驗證所需的晶圓廠認證準確度
Cadence數位與客製/類比EDA流程 獲台積電N6及N5製程認證 (2020.06.08)
全球電子設計廠商益華電腦(Cadence Design Systems, Inc.)宣佈,為台積電N6及N5製程技術提供優化結果,增強其數位全流程及客製/類比工具套裝。Cadence工具套裝運用於台積電最新N6及N5製程技術,已通過台積電設計規則手冊(DRM)及SPICE模型認證
Mentor Calibre和Analog FastSPICE平台 通過台積電最新製程認證 (2020.05.26)
Mentor(西門子旗下子公司)近期宣佈,該公司的多項IC設計工具已獲得台積電領先業界的N5和N6製程技術認證。此外,Mentor與台積電的合作關係已擴展到先進封裝技術,可進一步利用Mentor Calibre平台的3DSTACK封裝技術來支援台積電的先進封裝平台
Mentor產品線通過聯電新22奈米超低功耗製程技術認證 (2020.03.19)
Mentor, a Siemens Business近日宣佈,Mentor的多條產品線,包括Calibre平台、Analog FastSPICE平台,以及Nitro-SoC數位設計平台,現已通過聯華電子(UMC)的22uLP(超低功耗)製程技術認證


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